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[디지털 시스템 설계 및 실험] 4bit ripple counter

페이지 정보

작성일 23-05-06 10:01

본문

wire J1,NK,K1,D;

dppr dppr0(D,NC,Q,Q_);
1. JK 플립플롭 제작

레포트 > 공학,기술계열
input J,K,C;
jk jk3(J,J,Q[2],Q[3],,reset);

and (J1,J,Q_);
wire [3:0]Q;
wire J;

not (NC,C);

Download : [디지털 시스템 설계 및 실험] 4b.hwp( 47 )

input C,reset,NJ;
and(K1,NK,Q);
jk jk0(J,J,C,Q[0],,reset);

순서
output [7:0]oS_COM, oS_ENS;
not (nRST,RST);

wire NC;
seven segment

all all1(iCLK,nRST,Q,oS_COM,oS_ENS);
input iCLK,RST;
설명

wire nRST;

module toseg(C,NJ,reset,iCLK,RST,oS_COM, oS_ENS);

코딩
not (J,NJ);
코딩module jk(J,K,C,Q,Q_);
디지털 시스템 설계,4bit ripple counter
[디지털 시스템 설계 및 실험] 4bit ripple counter
1. JK 플립플롭 제작

jk jk2(J,J,Q[1],Q[2],,reset);
1. JK 플립플롭 제작 2. 4bit Ripple Counter 제작 1. JK 플립플롭 제작 코딩module jk(J,K,C,Q,Q_); input J,K,C; output Q,Q_; wire J1,NK,K1,D; wire NC; not (NC,C); dppr dppr0(D,NC,Q,Q_); and (J1,J,Q_); not (NK,K); and(K1,NK,Q); or (D,J1,K1);
output Q,Q_;
not (NK,K);
2. 4bit Ripple Counter 제작
or (D,J1,K1);
jk jk1(J,J,Q[0],Q[1],,reset);

다.

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